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2006年09月04日

HDL言語ひとりごと

久しぶりに Verilog触ってみたが、VerilogってC言語に似てて
気持ちが悪い
C言語に似ててうれしいのでは?とつっこまれるかもしれないけど、回路がソフトウェアのように手続き型で動いてしまうような気がして、気持ちが悪い。C言語ってほら後ろにアセンブラニーモニックが透けてみるじゃんか。
VHDLのように、後ろに回路が透けて見えるような言語のが俺は好みだ。

7セグLEDでA〜Zを表現する方法

http://ja.wikipedia.org/wiki/7%E3%82%BB%E3%82%B0%E3%83%A1%E3%83%B3%E3%83%88%E3%83%87%E3%82%A3%E3%82%B9%E3%83%97%E3%83%AC%E3%82%A4
Wikipediaより
A〜Fまでは普通だと思ってたんだけど。A〜Zまで全部とは。Wとかかなり強引。ほとんどDefineだ。